文章总数
代码之家
› 标签
›
synthesis
全部
verilog合成中从外部源接收输入时出现多个驱动器问题
Roman Andreevitch Biriukov
·
技术社区
·
elaboration
greatest-common-divisor
synthesis
verilog
· 7 年前
在“while”中使用一个非常量值会导致这个错误,我该怎么办?
sujeto1
·
技术社区
·
quartus
synthesis
verilog
math
· 8 年前
16位阵列如何需要5位地址(Xilinx Vivado HLS)?
Main
·
技术社区
·
digital-design
synthesis
xilinx
hardware
· 9 年前
1
2
3
4
5
6
下一页