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微LAZE AXI4异常

axi4 microblaze embedded

MateoConLechuga · 技术社区 · 8 年前

谢谢

The data cache AXI4 interface (M_AXI_DC) exception is caused by:

    - An error response on M_AXI_DC_RRESP or M_AXI_DC_BRESP,
    - OKAY response on M_AXI_DC_RRESP in case of an exclusive access using LWX.

The exception can only occur when C_DCACHE_ALWAYS_USED is set to 1 and the
cache is turned off

1 回复 | 直到 8 年前

MateoConLechuga 8 年前

这基本上意味着ECC在启用缓存的微博客设计中一文不值;因为它们不会触发任何硬件异常。

即使AXI-BRAM控制器的响应是SLVERR,微光栅也会按原样接受数据;好像什么坏事都不可能发生。

这是谁设计的。 .

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